IC693CPU321RR 高性能的算法處理，使用硬件描述語言去編寫算法的話，復雜程度高，工作量大，不易調試，產品的開發周期將非常長。這時，如果為系統添加專為算法而生的DSP的話，將會事半功倍。
眾所周知，DSP有專門為數字信號處理所設計的指令集和流水線，可 以方便高效的執行浮點數和復數運算等，這樣我們的理論算法就可以很方便的移植到實際的工程中，可以有效的縮短產品的開發周期。
DSP+FPGA的架構，可以把FPGA的高速采集和DSP的高性能算法處理完美結合。這種高度平衡的特性集合使其非常適合各種高性能嵌入式應用場合，如：
■ 視頻追蹤
■ 圖像處理
■ 軟件無線電
■ 雷達探測
■ 光電探測
■ 水下探測
■ 定位導航
在高速圖像處理領域，TMS320C6678與Kintex-7進行搭配的DSP+FPGA架構堪稱經典中經典，C6678擁有8核C66x，每核主頻高達1.25GHz，同時擁有高達320 GMAC和160 GFLOP的運算能力，可輕松駕馭圖像的復雜算法。配合Kintex-7的高速采集，完美契合各種視頻采集場景。
本文基于C6678+Kintex-7平臺，為大家介紹CameraLink、SDI、PAL、HDMI的視頻采集處理綜合案例。
TL6678F-EasyEVM評估板通過FMC高速接口，可接入CameraLink、SDI、PAL、HDMI等視頻采集模塊，并基于各個模塊提供了DSP+FPGA視頻采集處理綜合案例，同時提供免費技術支持服務。
FPGA端通過FMC視頻模塊TLCameraLinkF的CameraLink接口進行分辨率為2560 x 2048的視頻采集，再經過SRIO總線將視頻數據傳輸至DSP端進行Sobel（邊緣檢測）算法處理，然后將經處理后的圖像通過網頁進行顯示。
FPGA端作為SRIO Initiator，DSP端作為SRIO Target。FPGA端通過SRIO SWRITE和乒乓方式，將數據傳輸至DSP端的0x90000000和0x90500000的DDR地址空間。
案例使用北京微視的黑白CameraLink相機RS-A5241-CM107-S00，分辨率為2560 x 2048，幀率為107，灰度輸出，每個像素8bit，則數據量為2560 x 2048 x 107 x 8 = 4487905280 ≈ 4.5Gbps。案例使用SRIO的兩個Lanes，每個Lane傳輸速率為5Gbps，總數據有效帶寬為5Gbps x 2 x 80% = 8Gbps。
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